Infome del laboratorio 4 del curso de Hidraulica de canales dictado en la Pontificia Universidad Catolica del Peru.Descripción completa
Lab 4, Calculus 1
NetworkFull description
Fuerzas de presion sobre superficies planasDescripción completa
Real Reading 4 - Teacher's ManualFull description
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informe numero 4 electricosDescripción completa
Descripción completa
Programación de Aula
Wireshark Lab
E 83-100-4
TP 4 - 100% SociedadesDescripción completa
Description : E 83-100-4
trabajo practico n4Descripción completa
ELECTRÓNICA DE POTENCIADescripción completa
Descripción completa
Laboratorio de Volumetría.Descripción completa
laboratorio 4 de fisica 1 utp universidad tecnologica de panama
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UNIVERSIDAD TECNOLOGICA DE PANAMA CAMPUS CENTRAL VICTOR LEVI SASSO FACULTAD DE INGENIERIA ELECTRICA LIC. EN INGENIERIA ELECTROMECANICA ELECTROMECANICA CIRCUITOS LOGICOS ELECTRONICOS LABORATORIO N°4 COMPUERTAS CMOS Y SEÑALES LOGICAS GRUPO 1IE143 ESTUDIANTES DÍAZ, MANUEL 6-720-938 MORALES, JORGE 7-710-2144 PROFESOR WALDO MORAN
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Objetivos
1. Observa la realización de los bloques lógicos básicos a partir de transistores nMOS y pMOS presentando así el nivel básico básico para la familia CMOS. 2. Observa el comportamiento simulado de los bloques lógicos básicos CMOS usando señales estáticas como dinámicas.
3. Realiza bloques lógicos compuestos a partir de los bloques básicos y los simula usando Mul
4. Continúa la familiarización con la terminología t erminología usada en la descripción de los sistemas digit
Teoría
Existen varias tecnologías para la realización de los sistemas digitales electrónicos las más populare TTL, CMOS y ECL. Cada una exhibe diferencias en cuanto a su velocidad, consumo de energía, inmunidad al ruido y capacidad de integración (temas que serán estudiados en el futuro).
La TTL (Lógica a Transistores) es muy popular y ella en sí contiene una gama de subgrupos o famil
incorporan elementos auxiliares (Diodos y Resistores) que proporcionan diferentes características a uno, esta tecnología está basada en el transistor t ransistor de unión bipolar mejor conocido como BJT NPN y PNP. Su principal ventaja es su velocidad.
La ECL (Lógica aCoplada por Emisor) también está integrada a partir de transistores BJT pero cone
por el emisor en un arreglo arreglo similar a la compuerta de transmisión. transmisión. Su principal característica característica es su a inmunidad al ruido. La CMOS (MOS complementaria) conjuga transistores de tipo nMOS con pMOS conectados de
complementaria que hace que su realización sea muy sencilla. Su principal ventaja es el poco espac
Master your semester with Scribd consuRead ocupa en comparación con las otras tecnologías y su poco consumo, mo, sin no es tan rápida. Free Foron 30this Days Sign up toembargo vote title & The New York Times Useful Not useful
Cancel anytime. Esta práctica de laboratorio pone a prueba bloques lógicos implementados con transistores CMOS y
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son de fácil realización. Por ahora solo a nalizaremos su respuesta a señales de entrada digitales está
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Procedimiento Consulte con la práctica No 1 para interactuar con Multisim. I parte “NOT”
Realización y prueba del inversor lógico también conocido como NOT. Este es uno de los bloques l
básicos que solo posee una una entrada y cuya cuya salida corresponde al estado lógico contrario al de la entr
símbolo lógico estándar se presenta en la figura 1 sin embargo su función lógica se conceptualiza en parte circular del símbolo conocida como “Inversion “Inversion Bubble”
Si A = 1 entonces y = 0 Si A = 0 entonces y = 1
Figura 1 1.
Utilice la aplicación Multisim de NI disponible en el laboratorio para realizar el circuito que se
presenta en la figura 2. Use los mismos mi smos transistores pMOS y nMOS usados en la práctica ante 2.
Pruebe el funcionamiento del inversor CMOS en cuestión, utilice señal e stática (constantes lóg
señal dinámica (generador de funciones) Presente sus resultados al instructor y obtenga su firm
informe presente la tabla donde se verifica el comportamiento según la figura 1 (con los niveles voltaje obtenidos) y los esquemas gráficos que arrojan la simulación dinámica. VCC
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NOT CMOS
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Simulación estática y dinámica
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Parte (NAND CMOS)
La compuerta NAND es otro de los bloque básicos usados en los sistemas digitales su símbolo lógic
expresión lógica se presenta en la figura 3 a continuación. El bloque lógico NAND toma como míni entradas lógicas (1 bit c/u) y produce una salida que es función del estado las entradas.
y = 0 si y solo si, A = 1 y a la vez B = 1
Figura 3
3. Realice la compuerta NAND CMOS que se presenta en la Figura 4 usando Multisim y los mism
transistores MOS de la práctica anterior se sugiere incorporar un nuevo diseño para trabajar con libertad.
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Presente y demuestre esta parte al instructor: 5. Para la simulación dinámica use el set – – up up de la figura 5
Figura 5
6. Analice las señales obtenidas en el osciloscopio de cuatro canales, pero antes sepárelas vertical para facilitar esta tarea. Presente la salida salida dinámica al instructor: Funcionamiento dinámico: III
.
Parte (NOR CMOS)
La compuerta NOR es otro de los bloque básicos usados en los sistemas digitales su símbolo lógico
Master your semester with expresión lógica se presenta en la figura 6Scribd a continuación. El bloque lógico NOR al igual que el NA Read Free Foron 30this Days Sign up to vote title tomaNew como mínimo entradas lógicas (1 bit c/u) y produce una función & The Yorkdos Times Useful que useful del estado la salida esNot Special offer for students: Only $4.99/month. entradas.
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Figura 7 8. Demuestre la dinámica de este circuito al instructor.
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Asignaciones y Preguntas
Las compuertas que por definición se presentan como las básicas son l a NOT la AND y la OR estas
últimas pueden obtenerse de la combinación de la NAND l a NOR y la NOT revisadas en esta prácti
virtual. Una compuerta AND se logra al colocar un bloque NOT en cascada, o sea, a l a salida de un compuerta NAND. 1. Construya un bloque básico AND a partir de la conexión de un NAND y un NOT. a. Presente el circuito CMOS de este nuevo bloque lógico.
b. Realice una simulación dinámica aplicando a su nuevo circuito las señales que pro
los generadores de función XFG1 y XFG2 de la figura 5. Presente el resultado de simulación en el informe. c. Presente la tabla de funcionamiento de la compuerta AND.
2. Repita 1 pero construya ahora el bloque básico OR a partir de la conexión de un NOR y un N
Tabla de funcionamiento de la compuerta AND
INPUT
OUTPUT
A
B
A AND B
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0
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0
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Tabla de funcionamiento de la compuerta OR
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