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Indicaciones:
Las preguntas resaltadas con color naranja son preguntas cuyas respuestas no están confirmadas en el libro. Las preguntas resaltadas con color rojo son preguntas cuyas respuestas no se encuentran no han sido resueltas por los autores de este solucionario.
SOLUCIONARIO DEL LIBRO MICROPROCESADORES INTEL BARRY BREY 7º EDICIÓN CAPITULO 01: Introduccin !" #icro$roc%&!dor ' "! co#$ut!dor! c o#$ut!dor! 1( )*ui+n )*ui+n d%&! d%&!rro rro""o ""o "! "! #!,uin #!,uin!! !n!"-t !n!"-tic! ic!. . Charles Babbage /( En %" c%n&o c%n&o d% 10 &% uti"i uti"i2o 2o un nu%3o nu%3o di&$o&iti3 di&$o&iti3o o ""!#!do ""!#!do t!r4%t! t!r4%t! $%r5or!d! $%r5or!d!(( )*ui+n )*ui+n d%&!rro""o "! t!r4%t! $%r5or!d!. Herman Hollerith 6( )*ui+n )*ui+n 5u% 5u% %" 5und 5und!do !dorr d% IBM IBM cor$or cor$or!ti !tion. on. Herman Hollerith ( )*ui+n )*ui+n d%&!rro d%&!rro""o ""o "! "! $ri#%r! $ri#%r! c!"cu c!"cu"!dor "!dor!! %"%ctr %"%ctrnic!. nic!. Konrad use 8( )P!r! )P!r! ,u% $ro$&ito $ro$&ito &% d%&!rro""o d%&!rro""o %" $ri#%r $ri#%r &i&t%#! &i&t%#! co#$ut!ci co#$ut!cion!" on!" %"%ctrn %"%ctrnico. ico. !robablemente para dise"o de aeronaves # misiles durante la II guerra mundial 9( )L! $ri#%r! $ri#%r! co#$ut co#$ut!dor! !dor! $ror! $ror!#!;"% #!;"% d% $ro$&ito $ro$&ito %n%r!" %n%r!" &% ""!#o. ""!#o. ENI$C 7( E" $ri#%r $ri#%r #icro #icro$roc%& $roc%&!dor !dor %n %" #undo #undo 5u% d%&!rr d%&!rro""!d o""!do o %n 171 171 $or El Intel %&&% por 'ederico 'aggin( )ed )ed Ho** # Stan +a#or ( )*ui+n )*ui+n %r! "! con cond%& d%&!! d% Lo3 Lo3%"! %"!c%. c%. $ugusta $da B#ron ( )*ui+n )*ui+n d%&!rro""o d%&!rro""o %" $ri#%r $ri#%r "%nu!4 "%nu!4%% d% $ror!#!cin $ror!#!cin ""!#!do ""!#!do on >on N%u#!n. N%u#!n. Una ma,uina ,ue almacena las instrucciones de un programa en el sistema de memoria CAPITULO 0/: E" #icro$roc%&!dor ' &u !r,uit%ctur! 1( )*u% &on "o& "o& r%i&tr r%i&tro& o& 3i&i;" 3i&i;"%& %& $!r! $!r! "o& $ror! $ror!#!&. #!&. Son regist registros ros ,ue se utili-a utili-an n durant durante e la progr programac amaci.n i.n de aplicac aplicacion iones es # se especi especi*ic *ican an mediante mediante las instrucciones/ instrucciones/ 0os microprocesa microprocesadores dores 1&12 al !entium II se consideran consideran visibles para los programas/ /( E" 0/9 dir%ccion! r%i&tro& ,u% &on d% ' d% 32 ;it&( 6( )Cu?"%& #icro$roc%&!dor%& $u%d%n dir%ccion!r "o& r%i&tro& %@t%ndido&. 0os microprocesadores 1&412 # posteriores 5 1&%12( !entium( !entium !ro # !entium II( etc/6 ( E" r%i&tro %@t%ndido B &% dir%ccion! co#o c o#o EB7 / 8( )Cu?" r%i&tro u!rd! "! cu%nt! $!r! !"un!& in&truccion%&. EC7 5conteo6
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9( )Cu?" %& %" $ro$&ito d%" r%i&tro PIEIP. Guarda la direcci.n de despla-amiento del siguiente paso en el programa 7( )Cu?"%& &on "!& o$%r!cion%& !rit#+tic!& ,u% no #odi5ic!n %" ;it d% ;!nd%r! d% !c!rr%o. En las trans*erencias de datos o cuando se reali-a una operaci.n de control ( )Ocurrir? un d%&;ord!#i%nto &i &% &u#! un << con &ino ! un 01 con &ino. No( si suma 83 # 93 el resultado ser: cero( ,ue es un n;mero valido/ ( S% dic% ,u% un nu#%ro ,u% conti%n% 6 ;it& uno ti%n% $!rid!d impar/ 10( )Cu?" ;it d% ;!nd%r! contro"! "! t%r#in!" INTR %n %" #icro$roc%&!dor. 0a bandera I CAPITULO 06: Modo& d% Dir%ccion!#i%nto RM 1( )*u+ F!c% "!& &iui%nt%& in&truccion%& MO>. C AGB C BG A MO> BLGC C AG CS /( Li&t% Lo& R%i&tro& D% 0 Bit& *u% S% Uti"i2! P!r! E" Dir%ccion!#i%nto D% R%i&tro $0( $H( B0( BH( C0( CH( D0( DH 6( Li&t% Lo& R%i&tro& D% 19 Bit& *u% S% Uti"i2! P!r! E" Dir%ccion!#i%nto D% Lo& R%i&tro&( $7( B7( C7( D7( S!( B!( SI( DI ( Li&t% Lo& R%i&tro& D% 6/ Bit& *u% S% Uti"ic%n P!r! E" Dir%ccion!#i%nto D% R%i&tro& En Lo& Proc%&!dor%& 09 A P%ntiu# E$7( EBC( ED7( ES!( EB!( EDI( ESI 8( Li&t% Lo& R%i&tro& D% 19 Bit& *u% S% Uti"i2! P!r! E" Dir%ccion!#i%nto D% R%i&tro& M%di!nt% PUS GMO> Y POP CS( ES( DS( SS( 'S # GS 9( )*u% Error Ti%n% L! In&truccin MO> BLGC. N< SE !UEDE ES!ECI'IC$= )$+$> DSGSS. N< SE !E=+I)E CER 1/ ACIA AL MO>ER 1/6 ACIA A + $7(3@4H + C0(ER OCDM ACIA CL + SI(3&&&H MO>ER 100 ACIA SI + EB7(3@&&$@H MO>ER 1/00A/ ACIA EB 10 (H*u% S-#;o"o E&$%ci!" S% Uti"i2! A"un!& >%c%& P!r! D%not!r D!to& In#%di!to&( El sAmbolo
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CAPITULO 0: In&truccion%& $!r! #o3%r d!to& 1( E" $ri#%r ;'t% d% un! in&truccin %& %" c.digo de operaci.n ! #%no& ,u% cont%n! uno d% "o& $r%5i4o& d% &u&titucin( /( D%&cri;! %" $ro$&ito d% "o& ;it& D ' = ,u% &% %ncu%ntr!n %n !"un!& in&truccion%& %n "%nu!4% #!,uin!/ El bit D indica la direcci.n de *luo para los datos 5=EG hacia =+ o =+ hacia =EG6 # el bit indica el tama"o de los datos 5 b#te o palabra doble palabra6 6( *u+ in5or#!cin &% %&$%ci5ic! #%di!nt% %" c!#$o MOD %n un in&truccin %n "%nu!4% #!,uin!. Selecciona el modo de operaci.n de direccionamiento para una instrucci.n en lenguae ma,uina ( Si %" c!#$o d% r%i&tro REJK d% un! in&truccin conti%n% 010 ' =0 )*u+ r%i&tro &% &%"%ccion!G &u$oni%ndo ,u% "! in&truccin %&t? %n #odo d% 19 ;it&. D0 8( )Co#o &% &%"%ccion! "o& r%i&tro& d% 6/ ;it& %n %" #icro$roc%&!dor 09. Estableciendo el modi*icador /421 despuFs de la instrucci.n /+ SIGB/ %n un $ror!#! )Cu?" %& &u %,ui3!"%nt% %n "%nu!4% #?,uin! . 1B&@ CAPITULO 08: In&truccion%& !rit#+tic!& ' "ic!& 1( S%"%ccion% un! in&truccin ADD ,u%: a6 Su#% B ! A $DD $7( B7 b6 Su#% 1/ ! AL $DD $0( 3@H c6 Su#% EDI Y EBP $DD EB!( EDI d6 Su#% // ! C $DD C7( @@H e6 Su#% ! AL "o& d!to& dir%ccion!do& $or SI $DD $I( S0 *6 Su#% C ! "o& d!to& !"#!c%n!do& %n "! $o&icin d% #%#ori! RANA =$N$( C7
$DD
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/( )Cu?" %& %" %rror %n "! in&truccin ADD ECG A. No pueden usar registros de tama"o mito 6( )E& $o&i;"% &u#!r C ! DS con "! in&truccin ADD. No por,ue no se permite la suma de registro de segmentos ( Si A100 ' D/0<
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( )*u+ in&truccin MP %& d% 8 ;'t%&. Un salto 5J+!6 leano 0os b#tes @ # 4 LM contienen la nueva direcci.n del despla-amiento 0os b#tes % # O LM contienen la nueva direcci.n del segmento 8( )Cu?" %& %" r!no d% un &!"to c%rc!no %n "o& #icro$roc%&!dor%& 69HP%ntiu# . El rango es de P @ Gb#tes 9( Indi,u% %" ti$o d% in&truccin MP cortoG c%rc!noG "%4!noK ,u% &% %n&!#;"! $!r! "o& &iui%nt%& c!&o&( 5a6 Si "! di&t!nci! %& d% 0/10 LM cercana 5b6 Si "! di&t!nci! %& d% 00/0 LM corto 5c6 Si "! di&t!nci! %& d% 10000 LM leano 7( )*u+ $u%d% d%cir&% &o;r% un! %ti,u%t! ,u% 3! &%uid! d%" &ino d% "o& / $unto&. Que es una eti,ueta eterna ( )Cu?" r%i&tro o r%i&tro& c!#;i! %" &!"to c%rc!no $!r! #odi5ic!r "! dir%ccin d%" $ror!#!. El registro I! o EI! ( )Cu?" r%i&tro o r%i&tro& c!#;i! %" &!"to "%4!no $!r! #odi5ic!r "! dir%ccin d%" $ror!#!. 0os registros CS # I! 10( E@$"i,u% ,u+ F!c% "! in&truccin MP A( Id%nti5-,u%"! co#o un! in&truccin d% &!"to c%rc!no o "%4!no( 0a instrucci.n J+! $7 salta hacia la direcci.n de despla-amiento ,ue se almacena en $7( esto solo puede ser un salto cercano/ CAPITULO 07: U&o d%" "%nu!4% %n&!#;"!dor con cc 1(H )So$ort! %" %n&!#;"!dor %n "-n%! #!cro &%cu%nci!& %n "%nu!4% %n&!#;"!dor. No( la principal limitaci.n del ensamblador en lAnea es ,ue no puede utili-ar macro secuencias o instrucciones condicionales del *luo del programa/ /(H )Pu%d% un ;'t% d%5inir&% %n %" %n&!#;"!dor %n "in%! #%di!nt% %" u&o d% "! dir%cti3! DB. No( los b#tes deben de*inirse en C88 mediante el uso de char o deRint1/ 6(H )Co#o &% d%5in%n "!& %ti,u%t!& %n %" %n&!#;"!dor d% "-n%!. Se de*ine poniendo un nombre para la eti,ueta seguida de dos puntos/ (H )*u% r%i&tro& $u%d%n u&!r&% %n "%nu!4% %n&!#;"!dor '! &%! #du"o& %n "-n%! o %n"!2!do&K &in !"#!c%n!r&%. E$7( EB7( EC7( ED7 # ES 8(H )*u% r%i&tro &% uti"i2! $!r! d%3o"3%r d!to& %nt%ro& d% "%nu!4% %n&!#;"!dor !" $ror!#! %n "%nu!4% C ,u% Fi2o "! ""!#!d!. 9(H )*u% r%i&tro &% uti"i2! $!r! d%3o"3%r d!to& ti$o& $unto 5"ot!nt% d% "%nu!4% %n&!#;"!dor !" $ror!#! %n "%nu!4% C ,u% Fi2o "! ""!#!d!. 0a pila del coprocesador de uso *lotante/ 7(H )E& $o&i;"% uti"i2!r "! in&truccin (i5 %n %" %n&!#;"!dor d% "-n%!. No( por,ue /i* es un comando de +$S+ # el ensamblador en lAnea no soporta los comandos condicionales del +$S+
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(H En %" %4%#$"o 7H6G %@$"i,u% co#o "! in&truccin #o3 d"G c!d%n!1&i !cc%d% ! "o& d!to& d% c!d%n!1( $ccede a los datos en el arreglo cadena3 mediante el uso del registro SI para indicar el elemento tipo cadena/ (H En %" %4%#$"o 7H6G %@$"i,u% $or ,u% &% &!co ' &% #%ti %" r%i&tro SI( !or,ue solo se pueden usar $7( B7( C7( D7 # ES sin usar !USH # !
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Un bus de datos de 1 bits en el 1&11 un bus de datos de 32 bits en el 1&12( una terminal en el 1&11 en el lugar de terminal + en el 1&12/
en el 1&12( # un terminal I<
en el 1&11 en ve- de una
/( )E& %" 090 co#$!ti;"% con TTL. E@$"i,u% &u r%$u%&t!( SA # no/ El control de corriente de un cero l.gico se reduce a @/&m$ # la inmunidad al ruido se reduce a 4O&m?/ 6( )Cu?" %& %" 5!ctor d% &!"id! d%" 090 $!r! "o& &iui%nt%& di&$o&iti3o&.: !K 7 TTL: 3 ;K 7ALS TTL: 3& cK 7C CMOS: 3& ( )*u+ in5or#!cin !$!r%c% %n %" ;u& d% dir%ccion%&d!to& d%" 0 cu!ndo ALE %&t! !cti3!. 0os bits de direcci.n $& 9 $ / 8( )Cu?"%& &on "o& 5in%& d% "o& ;it& d% %&t!do S6 ' S. 0os bits S% # S4 muestran cual segmento se utili-a durante el ciclo de bus actual// estos dos bits de estado podrAan utili-arse para direccionar cuatro bancos de memoria separados de 3 +b#te si se decodi*ican como $@3 # $@&/ 9( )*u+ condicin indic! un 0 "ico %n %" t%r#in!" RD d%" 090. Una operaci.n de lectura/ 7( E@$"i,u% "! o$%r!cin d% "! t%r#in!" ' d% "! in&truccin =AIT( 0a terminal !rueba es una entrada ,ue se eval;a mediante la instrucci.n $I)/ Si s un & l.gico( la instrucci.n $I) *unciona como una instrucci.n N
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6( Li&t% %" n#%ro d% %"%#%nto& d% d!to& ,u% &% !"#!c%n!n %n cu d% "o& &iui%nt%& di&$o&iti3o& d% #%#ori! ' %" n#%ro d% ;it& %n cd!to a6 /@ @T posiciones de memoria de % bits cada una . @&%1 posiciones de memoria de % bits cada una b6 1@1 3T 53&@%6 posiciones de memoria de 3 bit cada una c6 @ %T 5%&V26 posiciones de memoria de 1 bits cada una d6 19@1 32T 53241%6 posiciones de memoria de 3 bit cada una e6 9@ 2%T 52OO426 posiciones de memoria de % bits cada una
( )Cu?" %& %" $ro$&ito d% "! t%r#in!" o %n un co#$on%nt% d% #%#ori!. Selecciona o H$BI0I)$ el dispositivo de memoria/ 8( )Cu?" %& %" $ro$&ito d% "! t%r#in!" %n un di&$o&iti3o d% #%#ori!. !ermite ,ue los datos *lu#an de las terminales de datos de salida de la =<+/ 9( )Cu?" %& %" $ro$&ito d% "! t%r#in!" !roduce una operaci.n de lectura/
%n un! SRAM.
7( )Cu?nto& ;'t%& d% !"#!c%n!#i%nto conti%n%n "o& &iui%nt%& di&$o&iti3o& d% #%#ori! EPROM. a6 /70 3T b#tes b6 /719 @T b#tes c6 /76/ %T b#tes d6 /79 1T b#tes e6 /781/ 2%T b#tes ( )Por ,u+ un! EPROM d% 80n& no 5uncion! dir%ct!#%nt% con un 0 ! 8M2. El microprocesador permite %2&ns para la memoria a O +H-( pero como ha# un pe,ue"o retraso en las coneiones a memoria( serAa meor no utili-ar un dispositivo de memoria de %O&ns en dicho sistema sin un estado de espera/ ( )*u+ $u%d% d%cir&% !c%rc! d% "! c!ntid!d d% ti%#$o ,u% &% n%c%&it! $!r! ;orr!r ' %&cri;ir %n un! $o&icin d% un di&$o&iti3o d% #%#ori!
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En el n;mero de puerto de ES de 32 bits/9 en D7
(H )En dnd% &% !"#!c%n! %" n#%ro d% $u%rto ES $!r! un! in&truccin d% ES d% c!d%n!. En el n;mero de puerto de ES de 32 bits/9 en D7 8(H )En cu?" r%i&tro &% introduc%n d!to& #%di!nt% "! in&truccin IN d% 19 ;it&. En el registro D7 9(H D%&cri;! "! o$%r!cin d% "! in&truccin OUTSB Se envAa un b#te desde la posici.n de memoria del segmento de datos direccionado por SI hacia el puerto direccionado por D7( despuFs SILSIL893 7(H D%&cri;! "! o$%r!cin d% "! in&truccin INS= Se introduce una palabra desde el puerto direccionado por DI # se almacena en la posici.n de memoria del segmento etra direccionada por DI despuFs DI L DIL89@ (H Co#$!r% un &i&t%#! d% ES $or !&in!cin d% #%#ori! con un &i&t%#! d% ES !i&"!d!
•
•
ES $or !&in!cin d% #%#ori! No utili-a las instrucciones de memoria IN( INS(
•
ES !i&"!d! Se deben emplear las instrucciones IN( INS(
(H )Cu?" %& "! int%r5!2 ;?&ic! d% %ntr!d!. El dispositivo b:sico para entrada es un conunto de b;*eres 5registros6 de tres
estados/
10(H )Cu?" %& "! int%r5!2 ;?&ic! d% &!"id!. Es un enclavamiento ,ue captura los datos de salida # los retiene para el dispositivo de salida/ CAPITULO 1/ : Int%rru$cion%& 1( )*u+ %& "o ,u% &% int%rru#$% d%;ido ! un! int%rru$cin. Interrumpe el programa ,ue se est: eecutando en cual,uier punto dado /( D%5in! %" t%r#ino int%rru$cin Una interrupci.n es una llamada a una subrutina iniciada por hardWare o so*tWare/ 6( )*u+ %& "o ,u% &% ""!#! d%;ido ! un! int%rru$cin. Se llama a un procedimiento el cual mediante el maneador de interrupciones o un procedimiento de servicio de interrupciones/ ( )Por ,u+ "!& int%rru$cion%& "i;%r!n ti%#$o $!r! %" #icro$roc%&!dor. Una interrupci.n solo utili-a tiempo de la computadora cuando se activa/ 8( Li&t% "!& t%r#in!"%& d% int%rru$cin %n %" #icro$roc%&!dor IN)=( N+I( IN)$/ 9( Li&t% "!& 8 in&truccion%& d% int%rru$cin $!r! %" #icro$roc%&!dor IN)( IN)4( IN)<( C0I( S)I/ 7( )*u+ %& un 3%ctor d% int%rru$cin. Es un elemento imprescindible para comprender las interrupciones de hardWare # so*tWare/
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( )En ,u+ $!rt% d% "! #%#ori! d%" #icro$roc%&!dor &% %ncu%ntr!n "o& 3%ctor%& d% int%rru$cin. En el primer 3Kb#te del sistema de memoria en modo real # en cual,uier parte de modo protegido/ ( )Cu?nto& 3%ctor%& d% int%rru$cin di&tinto& &% %ncu%ntr!n %n "! t!;"! d% 3%ctor%& d% int%rru$cin. @O2 10( )*u+ 3%ctor%& d% int%rru$cin %&t?n r%&%r3!do& $or Int%". Del &&H al 3'H/ 50as primeras 4@ posiciones6 CAPITULO 16: Acc%&o dir%cto ! #%#ori! 1( )*u+ t%r#in!"%& d%" #icro$roc%&!dor &% uti"i2!n $!r! &o"icit!r ' !c%$t!r un! tr!n&5%r%nci! $or DMA. Ha# dos se"ales de control ,ue se utili-an para solicitar # admitir una trans*erencia de acceso directo a memoria 5D+$6 en el sistema basado en microprocesador/ 0a terminal H<0D es una entrada ,ue se utili-a para solicitar una acci.n de D+$ # la terminal H0D$ es una salida ,ue admite la acci.n de D+$/ /( E@$"i,u% "o ,u% ocurr% c!d! 3%2 ,u% &% co"oc! un 1 "ico %n "! t%r#in!" d% %ntr!d! OLD( El microprocesador suspende la eecuci.n de la instrucci.n actual # *lota su direcci.n( in*ormaci.n # canales para control/ 6( Un! "%ctur! d% DMA tr!n&5i%r% d!to& d%&d% F!ci! Una lectura de D+$ trans*iere datos desde 0$ +E+<=I$ hacia E0 DIS!
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( D%&cri;! %" %5%cto %n %" #icro$roc%&!dor ' %" contro"!dor d% DMA cu!ndo "!& t%r#in!"%& OLD ' LDA %&t?n %n %" ni3%" d% 0 "ico( 10( E" contro"!dor d% DMA /67 %& un contro"!dor d% DMA d% c!n!"%&( El controlador de D+$ 1@4 es un controlador de D+$ de CUATRO canales/ CAPITULO 1: E" Co$roc%&!dor !rit#+ticoG "!& t%cno"o-!& MM ' SIMD 1( Li&t% "o& tr%& ti$o& d% d!to& ,u% &% c!r!n o &% !"#!c%n!n %n #%#ori! #%di!nt% %" co$roc%&!dor( Estos tipos de datos son Entero con signo( BCD # !unto *lotante/ /( Li&t% "o& tr%& ti$o& d% d!to& %nt%ro&G %" r!no d% "o& %nt%ro& ,u% $u%d% !"#!c%n!r&% %n %""o& ' %" n#%ro d% ;it& ,u% &% !&in! ! c!d! uno( !alabra 532 bits( P4@K6 Doble !alabra 54@ bits( P@ G6 !alabra cu:druple 52% bits( P V73&316 6( E@$"i,u% c#o %" co$roc%&!dor !"#!c%n! un n#%ro BCD %n #%#ori!( El *ormato decimal codi*icado binario 5BCD6 re,uiere 1& bits de memoria/ Cada n;mero se almacena como un entero empa,uetado de 31 dAgitos en nueve b#tes de memoria con dos dAgitos por b#te/ El dFcimo b#te contiene s.lo un bit de signo para el n;mero BCD con signo de 31 dAgitos/ 0a *igura a continuaci.n muestra el *ormato el numero BCD ,ue se utili-a con el coprocesador aritmFtico/
D17 D16 D15 D14D13 D12 D11 D10 D9 D8 D7 D6 D5 D4 D3 D2 D1 D0
FORMATO DE DATO !"D #ARA LA FAM$L$A %&'%( DE "O#RO"EADORE AR$TM)T$O
( Li&t% "o& tr%& ti$o& d% n#%ro& d% $unto 5"ot!nt% ,u% &% uti"i2!n con %" co$roc%&!dor ' %" n#%ro d% ;it& ;in!rio& ,u% &% !&in!n ! c!d! uno( !recisi.n simple 54@ bits6 Doble precisi.n 52% bits6 !recisi.n temporal 53@1 bits6 8( Con3i%rt! "o& &iui%nt%& n#%ro& d%ci#!"%& %n n#%ro& d% $unto 5"ot!nt% con $r%ci&in &i#$"%: !K /(78 ;K 9/ cK H0(918 dK 0(0 %K H1000(8 9( Con3i%rt! "o& &iui%nt%& n#%ro& d% $unto 5"ot!nt% con $r%ci&in &i#$"% %n d%ci#!"%&: 11110000 00000000 00000000 a6 11000000 9/O b6 00111111 &/O2@O 00010000 00000000 00000000 c6 01000011 2/O 10011001 00000000 00000000 d6 01000000 @/& 00000000 00000000 00000000 00100000 00000000 00000000 e6 01000001 3&/& *6 00000000 &/& 00000000 00000000 00000000
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7( E@$"i,u% ,u+ F!c% %" co$roc%&!dor cu!ndo &% %4%cut! un! in&truccin nor#!" d%" #icro$roc%&!dor( E" co$roc%&!dor !rit#+tico 5uncion! %n $!r!"%"o con %" #icro$orc%&!dor ( E@$"i,u% ,u+ F!c% %" #icro$roc%&!dor cu!ndo &% %4%cut! un! in&truccin d%" co$roc%&!dor( El microprocesador contin;a eecutando instrucciones de microprocesador 5tipo entero6( mientras ,ue el coprocesador eecuta una instrucci.n de punto *lotante/ ( )Cu?" %& %" $ro$&ito d% "o& ;it& C6 H C0 %n %" r%i&tro d% %&t!do. 0os bits de c.digo de condici.n indican condiciones relacionadas con el coprocesador/ 10( )*u+ o$%r!cin &% "or! #%di!nt% "! in&truccin
8( D%&!rro""% un! int%r5!2 d% ;u& ISA ,u% d%codi5i,u% "o& $u%rto& 060 066 $!r! contro"!r un t%#$ori2!dor /8
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9( D%&!rro""% un! int%r5!2 d% ;u& PCI d% 6/ ;it& ,u% !r%u% un! EPROM /7c/89 %n "!& dir%ccion%& d% #%#ori! <<<<0000H<<<7<<<
7( Su$oni%ndo ,u% cu%nt! con un ;5%r /LS/ ' un %nc"!3!#i%nto 7LS67G d%&!rro""% un! int%r5!2 d% ;u& ISA ,u% cont%n! un $u%rto d% %ntr!d! d% ;it& %n "! dir%ccin ES 60 ' un $u%rto d% &!"id! d% ;it& %n "! dir%ccin ES 60A
( Cr%% un! int%r5!2 d% ;u& ISA ,u% $%r#it! c!n!"%& d% &%!"%& d% &!"id! !n!"ic!&G d% 0 ! 8(0> c!d! un!( E&to& c!n!"%& d%;%r?n codi5ic!r&% %n "!& dir%ccion%& d% ES 600G 610G 6/0 ' 660 t!#;i+n d%&!rro""% %" &o5tV!r% ,u% &o$ort% "o& c!n!"%&
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( !! d% nu%3o "! $r%unt! G &o"o %n 3%2 d% c!n!"%& d% &!"id! u&!r ADC& $!r! cr%!r c!n!"%& d% %ntr!d! !n!"ic!& %n "!& #i!& dir%ccion%&( 10( M%di!nt% %" u&o d% un t%#$ori2!dor o d% 3!rio& t%#$ori2!dor%& /8G d%&!rro""% un t%#$ori2!dor cu!rto o&curo %n un! t!r4%t! d% ;u& ISA( Su t%#$ori2!dor d%;%r? %n%r!r un 0 "ico $!r! int%r3!"o& d% 1100 &%undo&G d%&d% 1100 &%undo& F!&t! 8 #inuto&( U&% %" r%"o4 d%" &i&t%#! d% M2 co#o 5u%nt% d% &incroni2!cin( E" &o5tV!r% ,u% d%&!rro""% d%;%r? $%r#itir !" u&u!rio &%"%ccion!r %" ti%#$o d%&d% %" t%c"!do( L! &%!" d% &!"id! d%" t%#$ori2!dor d%;%r? &%r un 0 "ico dur!nt% %" ti%#$o &%"%ccion!do ' $!&!r ! tr!3+& d% un in3%r&or $!r! F!;i"it!r un r%"%3!dor d% %&t!do &o"ido ,u% contro"% %" !#$"i!dor 5otor?5ico CAPITULO 19: Lo& #icro$roc%&!dor%& 019 01 ' 0/9 1( Li&t% "!& di5%r%nci!& %ntr% "o& #icro$roc%&!dor%& 090 ' 01901 Gran di*erencia entre estos es la anchura de los buses - 1&312 al igual ,ue el 1&12 contiene un bus de datos de 32 bits - 1&311 al igual ,ue el 1&11 trae un bus de datos de 1 bits 0as estructuras internas de estos son idFnticas/ !ero el 1&3121&311 contienen vectores de interrupci.n reservados adicionales # algunas caracterAsticas de ES integrados mu# poderosas conocidas como controladores integrados /( )*u+ #%4or!& &% !r%!ron !" 01901 ,u% no %&t?n $r%&%nt% %n %" 090. 0as meoras de hardWare inclu#en tempori-adores internos entradas de interrupci.n adicionales( l.gica de selecci.n de chip( puertos de comunicaciones en serie( terminales en paralelo( controlador de D+$ # un controlador de interrupciones/ 6( )En ,u% ti$o& d% circuito& int%r!do& 3i%n% %#$!,u%t!do %" 01901. En % versiones C+
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10( )Cu?nto ti%#$o d% !cc%&o ! #%#ori! $%r#it% %" 01901 &i &% o$%r! con un r%"o4 d% 10M2. @2& ns para la versi.n de 32 +H- ,ue opera a 3&+HCAPITULO 17 1( E" #icro$roc%&!dor 069 dir%ccion!WWW(( ;'t%& d% #%#ori! %n %" #odo $rot%ido %G /( E" #icro$roc%&!dor 069 dir%ccion!WWW(( ;'t%& d% #%#ori! 3irtu!" #%di!nt% "! unid!d d% !d#ini&tr!cin d% #%#ori!( 2%) 6( D%&cri;! "!& di5%r%nci!& %ntr% %" 069D ' %" 069S El 1&412D7 utili-a bancos de memoria a travFs de B0E # BHE( en el 1&412S7 los bancos de memoria se utili-an a travFs de habilitaci.n de banco( BE49BE& El 1&412S7 no contiene la terminal de direcci.n $& debido a ,ue esta decodi*icada en las se"ales B0E # BHE El 1&412D7 no contiene las coneiones de direcci.n $& # $3 por,ue est:n codi*icadas como las se"ales de habilitaci.n de banco/ El 1&412S7 tiene un bus de direcciones de 32 bits # el 1&412D7 de 4@ bits ( Di;u4% %" #!$! d% #%#ori! d%" 069 cu!ndo &% o$%r! %n %" !K #odo $rot%idoX ;K #odo r%!"(
8( )Cu?nt! corri%nt% F!' di&$oni;"% %n "!& di3%r&!& con%@ion%& d% "!& t%r#in!"%& d% &!"id! d%" 069.co#$!r% %&t!& corri%nt% con "!& corri%nt%& di&$oni;"%& %n "! con%@in d% t%r#in!" d% &!"id! d% un #icro$roc%&!dor 09 Cada una de las terminales de salida del 1&412 son capaces de suministrar %/& m$ 5coneiones de direcci.n # de datos6 o O/& m$ 5otras coneiones6( representando un aumento en comparaci.n de los @/& m$ disponibles en las terminales de salida del 1&12 9( D%&cri;! %" &i&t%#! d% #%#ori! d%" 069X %@$"i,u% %" $ro$&ito ' "! o$%r!cin d% "!& &%!"%& d% &%"%ccin d% ;!nco( El tema de memoria tiene hasta % Gb#tes # las se"ales de habilitaci.n de banco seleccionan uno o m:s de los bancos de memoria de 1 bits/ 7( E@$"i,u% "! !ccin d% un r%inicio d% F!rdV!r% %n "!& con%@ion%& d%" ;u& d% dir%ccion%& d%" 069 el reinicio iniciali-a el 1&412( con lo cual empie-a a eecutarse el so*tWare en la posici.n de memoria '''''''&H/ el 1&412 se reiniciali-a en modo real( en tanto ,ue las 3@ coneiones de
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direcci.n de mas a la i-,uierda se mantienen en el nivel de 3 l.gico 5'''H6 hasta ,ue se eecutan un salto leano/ 'acilitando la compatibilidad con los microprocesadores antiguos
( E@$"i,u% co#o "! c!n!"i2!cin %@ti%nd% %" ti%#$o d% !cc%&o $!r! #ucF!& r%5%r%nci!& ! #%#ori! %n %" &i&t%#! ;!&!do %n %" #icro$roc%&!dor 069 0a canali-aci.n permite ,ue el microprocesador enviF la direcci.n de la siguiente posici.n de la memoria mientras retiene los datos de la operaci.n de la memoria anterior/ 0e permite a la memoria un tiempo adicional para acceder a los datos ( D%&cri;! %n 5or#! ;r%3% co#o 5uncion! %" &i&t%#! d% #%#ori! c!cF+ 0a memoria cache es un b;*er ,ue permite ,ue el 1&412 *uncione de una manera mas e*iciente con menores velocidades de D=$+/ +eora el rendimiento general de los sistemas de memoria para los datos ,ue se utili-an m:s de una ve-/ !or lo general los dispositivos de memoria cache son componentes de memoria =$+ est:tica con tiempos de acceso menores a 3& ns/ 10( En %" 069G "o& $u%rto& d% ES co#i%n2!n %n "! dir%ccin d% ES ' &% %@ti%nd%n F!&t! "! dir%ccin d% ES &&&&H9''''H